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2026-10-19 日報
晶片與算力

Nvidia 要求 NVHBM 基礎晶粒統一採台積電 3 奈米製程,三星打破全包模式首度配合

Techmeme綜合 3 家報導多家報導
已查原文 · 4 項主張

多個報導來源提及此事;未必是彼此獨立的證據。

待查報導的核心主張源自韓國《首爾經濟日報》的產業獨家報導,並經中央社、IT之家及多家韓媒轉載引述。核對已讀來源,報導中提及 Nvidia 要求三大記憶體廠於 NVHBM 基礎晶粒統一採台積電 3 奈米、核心晶粒採 1c 製程,三星 DS 部門首度同意配合於 HBM 階段採用台積電代工,以及三星在標準品維持自製並準備自家產線作為產能預案等主要細節,皆獲已讀媒體報導支持。

Nvidia 要求三星電子、SK 海力士與美光在客製化記憶體 NVHBM 上,基礎晶粒統一採台積電 3 奈米製程,核心晶粒統一採代號 1c 的第六代 DRAM 製程。

多家媒體引述韓媒《首爾經濟日報》業界消息指出,Nvidia 已向三星、SK 海力士及美光提出要求,NVHBM 基礎晶粒統一由台積電 3 奈米生產,核心晶粒採用 1c DRAM 製程。

使用台积电 3 纳米工艺制造基底裸片

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코어다이에는 6세대 10나노급인 1c D램을 적용

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三星 DS 事業部評估後同意配合 Nvidia 要求,此為三星首次在 HBM 製造階段採用台積電代工服務。

中央社引述報導指出,三星內部審查後決定同意 Nvidia 要求,這將打破過往全包模式,為三星首次在 HBM 製造階段採用台積電代工合作。

首次在HBM製造階段與台積電合作

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NVHBM 為 Nvidia 於 8 月發布、基於 HBM4E 架構的客製化產品,將記憶體控制器整合至基礎晶粒中,統一製程旨在標準化並縮減驗證流程。

報導指出 NVHBM 為 Nvidia 於 8 月發布的 HBM4E 架構客製化記憶體,藉由將控制器整合進基礎晶粒並統一製程規格,以利標準化並減輕驗證負擔。

8月發表的NVHBM將輝達客製化記憶體控制器整合進基礎晶粒

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三星在標準 HBM 與 AMD 等客製化訂單維持全包自製策略,同時評估於自家產線製造 NVHBM 基礎晶粒以因應台積電產能不足風險。

報導指出三星對標準 HBM 產品及 AMD 等客戶訂單仍維持全包自製,同時三星也正在驗證自家產線生產 NVHBM 基礎晶粒,作為台積電產能不足時的應對預案。

防止 NVHBM 需求超出台积电产能上限

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Nvidia 已向三星電子、SK 海力士與美光提出要求,針對其客製化記憶體 NVHBM,基礎晶粒(base die)統一採用台積電 3 奈米製程生產,核心晶粒(core die)則統一採用代號 1c 的第六代 DRAM 製程。三星裝置解決方案(DS)事業部經內部評估後已同意配合,這是三星首次在 HBM 製造階段採用台積電代工服務。 NVHBM 為 Nvidia 於 8 月發布的客製化產品,基於第七代 HBM4E 架構開發,並將 Nvidia 自行設計的記憶體控制器整合至基礎晶粒中。由於過往各供應商製造方案不同,難以在相同設計下維持一致效能,Nvidia 透過強制統一製程以利標準化並縮減驗證流程。 過往三星 HBM 的核心晶粒與系統半導體基礎晶粒均由內部全包生產。針對標準 HBM 產品,三星仍維持全包自製策略,目前量產的第六代 HBM4 與量產驗證中的 HBM4E 基礎晶粒均採自研 4 奈米製程,核心晶粒則由華城與平澤廠的 1c 產線供應。針對 AMD 等其他客戶的客製化訂單亦維持自製模式。此外,為因應台積電產能可能不足的風險,三星目前也在驗證於自家晶圓產線製造 NVHBM 基礎晶粒的可行性。
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背景

High Bandwidth Memory(HBM)包含基礎晶片(base die)架構,台積電(TSMC)本身即具備生產 HBM base die 的能力。依照產業規劃,TSMC 預計於 2026 年成為多家 HBM 廠商的晶圓代工夥伴。

來源